CN1047667C - 同步化电子识别系统 - Google Patents

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Abstract

本发明涉及包含一个查询器和多个转发器的识别系统。该查询器包括用于将查询信号发送到转发器的发送器装置，用于从转发器接收响应信号的接收器装置，以及用于从响应信号中的数据识别转发器的处理器装置。进一步提供有从响应信号中提取转发器时钟信号的时钟提取装置，用于将查询信号的修正同步于来自转发器的响应信号。

Description

同步化电子识别系统
本发明涉及包含一个查询器和多个转发器的识别系统。
南非专利申请92/0039描述了一个包含有一个查询器和若干个单独的转发器的识别系统，每一个转发器与一个欲被识别的目标(article)相关联，这些目标可以是诸如车辆、超级市场或仓储室的货栈项台或者是人。
在上述的专利申请的系统中，在一些非常的境况中有可能出现这样的情形，即来自距查询器相当远的一个转发器的信号可被来自查询器附近的转发器的信号所淹没，从而导致较远转发器的无法识别。
本发明之目的即是为了在上面提及的系统中改良转发器识别的可靠性。
根据本发明，一个识别系统包括一个查询器和多个转发器，该查询器包括有用于将一查询信号发送到转发器的发送机装置，用于从转发器接收响应信号的接收机装置，以及用于从在响应信号中的数据识别转发器的处理器装置；每一个转发器包括用于接收查询信号的接收机装置，一个转发器时钟产生器，一个编码产生器，发送机装置和连接到该编码产生器的一个调制器，以便一经收到查询信号，该转发器即转发一个包含有识别该转发器的数据的响应信号；该查询器被用来检测来自任一转发器的响应信号的成功的接收，从该转发器的响应信号提取一同步信号，并且与该响应信号同步地修正该查询信号以便指示响应信号的成功接收，每一个转发器都包含有对查询信号的各个修正作响应，以中止其响应信号的发送的装置。
更可取地是查询器包括一时钟提取装置用以从响应信号中提取一时钟信号，该响应信号被用于将查询信号的修正与响应信号同步。
时钟提取装置可被采用来产生一伪转发器时钟信号，该信号跟随被提取的转发器时钟信号的频率。
该时钟提取装置最好包括一个产生伪转发器时钟信号的压控振荡器，以及被提取的时钟的监视器装置，该监视器装置监视该被提取的转发器时钟信号的出现并且控制该压控振荡器，以便在没有被提取的转发器时钟信号的情况中保持伪转发器时钟信号恒定的频率。
该查询器可以包括定时基准装置，被安排来产生一个用以控制压控振荡器的输出电压，当一个转发器响应信号被接收时，该输出电压最初与在转发器响应信号中的一同步码值相关。
该定时基准装置可被安排来产生一斜坡电压，由该斜坡所达到的电压值与在转发器响应信号中的一同步比特的持续期相关。
该查询器可被用来将查询信号修正一个转发器时钟周期的第一预定数，在查询器连续接收转发器响应信号之后，修正转发器时钟周期的一个第二预定数。
在一最佳实施例中，该查询信号是通过被中断而被修正的。
转发器可以包括逻辑电路，用来监视查询信号的修正，并且仅当该查询信号的修正(值)具有与转发器时钟周期的一预定数的持续期相关的一个持续期时，该逻辑电路使转发器停止其响应信号的传送。
该逻辑电路可被安排为在一个对应于单一转发器时钟周期的一个周期上来监视该查询信号的修正。
该查询器可被用来至少第二次修正查询信号，从而修正一个转发器时钟周期的第三预定数，在查询器连续地接收该转发器响应信号之后，修正转发器时钟周期的一个第四预定数。
转发器最好包括控制装置，用于检测查询信号的第二修正，并且在转发器停止接收查询信号之后将该转发器阻塞一预定的时间。
该预定的时间最好由包含一个充电存贮器件的定时电路确定，该充电存贮被安排成由取自查询信号的能量充电，而在转发器停止接收查询信号之后以一个受控速率放电。
查询信号的修正最好包含有以受控速率出现的过渡，以保证由该过渡产生的最大频率处于一可接受的范围内。
在本系统的另一个实施例中，尤其适用在防窃应用中，响应于查询信号修正的装置被用来将转发器阻塞一预定的时间间隔。
这会使得在一零售出口中的目标所附的一个转发器被阻塞在一个账台或结账状态，以使得该转发器不响应来自一出口的查询器的查询信号。
依照本发明，还进一步提供有使用在上述定义的系统中的一个转发器，该转发器包括有用于接收一查询信号的接收器装置，一个转发器时钟产生器，一个码产生器，一个发送器装置，一个与该码产生器连接的调制器，以便在当接收该查询信号之时由该转发器发送一个含有指示该转发器的数据的响应信号；该转发器进一步包括有与响应信号同步的查询信号的各个修正作响应的装置，并指明来自其响应信号的转发器的成功的识别，以便停止其响应信号的传输。
该转发器可包括有逻辑电路，安排为监视该查询信号的修正，并且仅在查询信号的修正具有与转发器时钟周期一预定数的持续期相关的一个持续期的情况下，使得该转发器停止其响应信号的传送。
最好是该转发器逻辑电路被安排为在对应于一个单一转发器时钟周期的周期上监视查询信号的修正。
响应于查询信号修正的装置可被用来使该转发器阻塞一预定的时间周期。
转发器可以包括有控制装置，安排来检测查询保征的一个第二修正，并在该转发器停止接收该查询信号之后，将该转发器阻塞一预定的时间。
该预定的时间可以由一个定时电路所确定，该电路包括有一个充电存储器件，安排得由取自查询信号的电能所充电，并且在该转发器停止接收该查询信号之后，以一个受控速率放电。
图1是一个依照本发明的查询器的简化方框示意图；
图2是表示本发明转发器的基本操作的方案图；
图3是说明图1的查询器在使用中的操作的流程图；
图4是说明该查询器电路各部分出现的波形的定时图；
图5是图1查询器的同步电路的示意图；
图6是说明识别系统的第一方案之操作的定时图，表明转发器和查询的相互作用；
图7是本发明识别系统的第二个实施例的一个定时图；
图8是根据本发明第二实施例的一个转发器的简化方框示意图；
图9是图8的间隙(gap)检测逻辑电路的示意图；
图10是说明图8转发器操作的流程图。
本发明涉及一个与南非第92/0039号专利申请所描述的发明相类似的一个识别系统，其内容结合在本申请中作为参考。这种识别系统的一个例子包括一个查询器或读取器，它以大致为915MHZ的频率将大约为15W功率的查询信号发送到若干个无源转发器。该转发器从该查询信号的能量中获取电能量，并且利用一个识别码对于从该查询器接收的部分能量进行调制，以产生发送回该查询器的一个响应信号。
转发器可以采用分别的接收器和发送器天线，或者是接收与发射同用一个天线。响应信号可以通过调制这种天线的反射波而生成，而不是采用将接收器天线所获的能量由一调制器转发到发送器的天线。作为一个选择，转发器可被独立地供电，并产生其自己的响应信号。
在上面提到的专利申请中所描述的系统，在接收来自查询器的查询信号以后，发送其本身的响应信号之前，对每一个转发器都提供等待一个随机的或伪随机的周期。任何转发器的成功的识别都是由紧随任何特定转发器之响应信号的成功接收之后的查询信号的短暂中断或其它的修正所指示的。这对于相关转发器作用如同一关断信号。在响应重复的查询信号的过程中，在产生响应信号时的这种随机或伪随机的延时确保了所有的转发器都将最终由查询器所识别。
通常，如果两个转发器基本上同时地发送各自的响应信号，则会由于这两个响应信号间的相互干扰而使查询器不能成功地识别它们的任何一个。在响应随后一个查询信号过程中，这两个转发器将以各自的新的随机或伪随机延时发送另外的响应信号，并随之被检测。然而，在上述情形的极端情形下，这两个转发器其中之一可能要比另一个要靠近查询器许多，从而使它的响应信号淹没(swamp)掉另一个转发器同时发出的响应信号。在这种情形中，该查询器可能成功地接收这两个转发器中较近者的响应信号，然后将通过修正其查询信号来指示响应信号的成功接收，以便指令较近的转发器自行关闭。这可能会被两个转发器都认为它们各自的响应信号已被成功地接收，从而二者都切断。这将会导致第二个转发器没有被计数。
为了克服上述最坏案例的情况，并从整体上改善这一类转发器检测的可靠性，其查询器包含一个同步电路，该电路从成功接收的转发器响应信号中提取一个时钟信号，并且使用于证实响应信号之成功接收的查询信号的中断同步于相关转发器的操作。由于每一个转发器都有其自己的内部时钟，其时钟频率取决于源于查询信号的电源电压以及在该转发器内的时钟元件的容限，所以不同转发器的时钟频率会有很大的改变。因此，通过将查询信号的切断同步于相关转发器的时钟频率，则会使已基本上同时地发送其响应信号以及其(与另一转发器)具有完全相同的时钟频率的另一个转发器的机会极小。这样就在实际上改进了检测的可靠性。
图1示出了查询器的同步电路。该电路包括一个对从转发器接收的响应信号进行放大的放大器10，转发器响应来自查询器的一个查询信号。该信号载有一个曼彻斯特(Manchester)码格式的转发器识别码。信号被送到一个转发器时钟提取电路12、一个数据提取电路14和一个起始检测电路16。所提取的数据和所提取的时钟连同来自动态指示电路34的“忙音”(Busy)信号一起送到微处理器18，以实现码的有效性，这种忙音信号是当起始检测电路16和被提取时钟监视器电路20都提供一个输出时被产生的，表示其硬件正在忙于处理一个已接收的码。该起始检测电路16监视放大器10的输出，以便通过在一被接收码的起始处寻找常量比特来确定一个转发器响应码是在什么时候开始的，并且在这些常量比特被检测到时，将一个输出信号送到动态指示器电路34。如果动态指示器电路同时地接收来自被提取时钟的监视器电路20的输出信号，则它送一个“忙音”信号到微处理器，以便启动一解码周期。
时钟提取电路12监视在已接收曼彻斯特码中的整个过渡，只允许这种过渡在大致以该比特周期为中心的一个确定容限之内出现，从而产生时钟脉冲。转发器时钟提取电路12的这种输出脉冲序列被送到相位比较器电路22，并与压控振荡器(VCO)26的输出相比较，以便修正在定时基准电路输出端持有的一个定时基准电压(Vref)。这一基准电压使得VCO26在该转发器码的最后比特被发送之时产生出其频率锁定于已提取的转发器时钟频率的一个“伪转发器时钟”。与此同时，已提取时钟监视电路20监视被提取的时钟。当转发器码的最后比特已被接收时，对应于来自该转发器数据最后比特传输之时的转发器时钟频率，不再有更多的转发器时钟脉冲可被提以，并且该被提取的时钟监视器电路20指令VCO26保持其目前的输出频率。
VCO26的输出被送到一个查询器关断逻辑电路28，(该电路的输出信号)与来自微处理器18的一个“有效码”信号相结合，经逻辑电路32控制着该查询器的发送器电路30的操作。在由该查询器成功地接收响应信号之时，其查询信号被修正，以使之通知相关转发器其响应被接收，并且它必须停止其码的进一步的发送。
转发器操作在图2中示意性地示出。当转发器接收到一个查询信号时，它将自身的识别码调制到该查询信号上，并将一响应信号发送回该查询器。随之该转发器的内部逻辑则监视着查询信号，以寻找由查询信号中的短暂中断所表示的“关断”指令。如果该关断指令被检测到，该转发器停止其发送。如果检测不到关断指令，在一随机或伪随机的延时之后，该转发器响应下一个查询信号而再次输出它的识别码，并且这一过程被重复。
如图2所示，转发器发送的码包含若干个常量(quiet)比特，随后是同步比特，接着是含有该转发器识别数据的曼彻斯特码。一个比特是一个常量比特周期，其处无信号(逻辑低电平)被发送，且应当可区别于一个曼彻斯特“零”比特，其中前半比特周期发送“低”电平而后半比特周期发送“高”电平。在一个曼彻斯特码中，一个正的或负的过渡总是出现在该比特周期的中间。这一事实被该查询器同步电路采用来提取用于在转发器中产生曼彻斯特码的时钟。该同步(sync)比特是一个逻辑“1”比特，当该比特以曼彻斯特格式被发送时，其与时钟以这样的方式来结合，即，当常量周期是“低”电平时，在比特前半部分其曼彻斯特比特为“高”值而在比特的后半部分其曼彻斯特比特为“低”值。由于定时基准是源于同步比特的曼彻斯特码表示的前半个部分中的脉冲宽度的测量，因而重要的是这一脉冲要出现在该比特的前半部分而不是在该比特的后半部分。
图3示出了该查询器硬件工作进行步骤的流程图，而一些有关的波形在图4中示出。
步骤1：放大器10的输出被监视以找常量比特，以便发现转发器识别码的起始。在常量比特之后被送出的第一个比特是同步比特，它是被用于确定周期，因而确定码的频率的比特。来自动态指示器34的忙音信号送到微处理器18以指示解码周期的开始。
步骤2：在定时基准电路24中的恒流源产生一定时基准斜坡电压Vref，它在同步脉冲的持续期被取样并随之被保持。这一基准电压直接涉及码的时钟频率。
步骤3：定时基准斜坡电压被连续地产生，并且该电压被与该基准的加数产生值相比较。在图4中所示出的波形表示出在1.5倍的基准电压值时其数据是如何被锁存以及在两倍的基准电压处时钟如何产生，该时钟由微处理器18用来读取在数据提取电路14的输出端的数据。当所提取的时钟脉冲出现在大致为两倍基准电压的被接受的容限之内时，该定时基准斜坡(电压)被复位。当时钟出现时该斜坡被取样和保持，并被与基准比较，该基准被修正，以便跟踪转发器的时钟频率。
步骤4：当不再有时钟脉冲被接收时(在最后一个码比特已被解码之后)，该斜坡不被复位，且达到一个四倍于基准的电压值，启动步骤5。
步骤5：在此时，已提取时钟监视电路20将一个“保持”信号输出到VCO26，它将定时基准电压保持在它的现行值，以使得VCO连续地产生出它现行的输出频率。如果微处理器确定该被解码的码是有效的，则它将启动查询器关断逻辑，以指示该转发器，它已被成功地识别。假如它不是一个有效码，则该微处理器18将通过发送一个“复位”信号到起始检测电路16来复位该电路，并将寻找下一个码。
步骤6：为了指示业已成功识别的相关转发器，查询器信号被修正。在本实施例中，是通过以下述的精确的方式将发送器30关闭一短暂周期而实现的。
图5更为详细地示出了相位锁定以及时钟提取过程是如何产生的。起始检测电路16监视着在放大器10输出端的曼彻斯特码并指示码的动态，这一状态启动基准查询步骤2。一斜坡电压产生器36的输出信号由一个取样和保持电路38在同步脉冲的结束时刻取样并被保持。基准电压(Vref)由一放大器40放大4倍，并用来借助分压器及比较器网络42产生出若干不同的基准电平。定时斜坡电压连续地产生并与基准网络比较，以便确定进行什么操作。在一个曼彻斯特周期的前半部分是处于1.5倍的保持基准电压，而且这一状态被锁存到D型触发器66中。当这一状态的过渡出现于在该比特周期中间其容限(1.8Vref-2.2Vref)内时，就产生被提取的时钟脉冲。微处理器18利用这一脉冲来读取D型触发器的锁存输出。这一操作被重复至码及相关提取时钟的持续期(那么长的时间)。所产生的这些基准电压是以这样的事实为基础，即，该被保持的基准电压是正比于在同步比特周期的前半部分中被测的半比特周期的脉冲宽度。
当一时钟脉冲出现时，一个相位比较器取样与保持电路46对定时基准斜坡电压其值进行取样并保持，而且在经一除法器电路48除2以后，将其取样值与被保持的定时基准(Vref)相比较。如果有任何差异出现，该差异的一部分经加法器50与基准(Vref)相加，以便将该基准电压，进而将产生的时钟频率拉向已提取的转发器时钟频率的新值。当码结束时，无另外的时钟可被提取，从而导致斜坡电压产生器36不被复位。随后该斜坡电压将达到4位的Vref值，并且比较器42的输出操作一个逻辑开关52，该开关复位斜坡电压不生器36并进一步以两倍于已更新的定时基准周期(Vref)产生伪时钟脉冲。
微处理器18在每一时钟脉冲上读取数据输出信号，并通过一个误差检测汇编程序确定码的正确性。在本实施例中，采用的是一个简单地奇偶检测汇编程序。假如该码通过该检测，则微处理器将使查询器关断逻辑以修正该查询信号，并经过一系统接口54将该码送到查询器系统的处理电路。
参考图6，其中的波形图以图示的方式示出了该查询器是如何将其短暂关断或“切断”信号同步于转发器的操作。图6的图示出了一个由转发器产生的一个调制信号56，且该信号在转发器时钟波形58的第N＋1周期完成。两个时钟周期以后，在时钟周期N＋3，该转发器逻辑电路检查是束该查询信号还在被接收。紧随转发器时钟周期N＋3，查询器立即关断它的查询信号，降其输出功率60到零，并保持其关断状态直到转发器时钟周期N＋6的完结。在时钟周期N＋6的结束处，转发器逻辑检查该查询信号是否仍不存在。该查询信号则被恢复到满功率。在时钟周期N＋7转发器逻辑检查该查询信号是否再次出现。这一检查是在时钟周期N＋8被重复的。假如所有的检查是正确的，则该转发器决定将来自查询器关断信号加到其上，并阻塞另外的响应信号的传送。该转发器保持关断直到这样的时间，即当该查询信号已经保持关断了一段预定时间，以使所有的转发器复位，并保持关断到随后的查询信号被恢复为止。
在图6中的波形62是在检测来自转发器的有效响应信号码时由查询器数据提取及码的有效化电路所产生的脉冲，而波形64是由转发器的内部逻辑电路产生的转发器启动信号。如图中所见，在来自查询器的关断信号的确证之后，在转发器时钟周期N＋8的结束处转发器启动信号改变状态。
为避免产生不希望的射频干扰，该查询信号并不是立即被关断或恢复，而是像在图6中所示的那样，是在经过至少一个转发器时钟周期而由查询器关断逻辑电路28以一个受控速率予以关断或恢复。该关断/接通序列的上升时间和下降时间被控制，以保持由在一可接受的范围内的过渡而产生的最大频率。这是通过在发送器30的输入端处的一个滤波器电路完成的，该滤波器电路限制了加至发送器输入端的驱动信号的上升和下降时间。
转发器在查询器关断信号结束时监视“上升沿”而不是下降沿，因为下降沿的特性更易趋于随着系统的容量和其它元件参数以及随着由发送器所耗功率的改变而改变。
上述技术的结果是，在由每一个转发器所监视的查询信号的“关断”窗口仅在一个时钟周期的宽度(即在N＋6到N＋7内的时钟周期)有效，这样就降低了两个转发器同时地都发送和切断的可能性。在一个包括有1000个转发器的系统中，这种错误的可能性被降到大约0.01％。
在某些应用中，对于某些转发器来说，有必要查询多次，这些查询间有短暂的时间间隔，而随后它们则被以较长的时间间隔查询。出现这样应用的一个例子是当本发明的转发器被用来识别超级市场中货栈物品项目时。当着运货车辆达到超级市场时，车辆的内容由一个查询器扫描，结果的打印或显示与一个送货单或清单相比较。假如有任何不相符之处被发现，在一个相当小的时间间隔内可能需要重复该查询过程。这一操作规程如上所述。
在超级市场的结账处，当用户以每一个都带有转发器的各类货物装满他的货车时，这些转发器将由一个连接于一个账台的查询器再启动和读取。为了防止在这种自选服务结账中的偷窃，该查询器发送一个附加的关断信号到转发器，以便在转发器已被从查询场移出以后使其关闭一段长时间。
在超级市场的出口，安置有一保安结账，能够检测出由于其程序的失效而未被提交的任何转发器。有时，在顾客已经离开超级市场之后，转发器再次启动，以使它们能够在家使用。比如说，顾客可以在家中拥有查询器，可以用来读出配餐室的内容，以确定还需要再购买哪些货项(反之，在他们经过结账以后，这些转发器可以被去掉或销毁)。
为了实施本发明之方案，转发器被设计成用来寻找两个连续的关断信号。该转发器以如上述的方式响应第一个关断信号。当这个关断信号被检测到时，只要是该转发器保持在该查询器的场范围内，它就停止其它的发送。此时，转发器则寻找第二个关断信号。如果第二个关断信号被检测到，该转发器就利用来自查询信号的能量来充电一个电容器，这样就在该转发器业已从该查询器场移出后，将该转发器的码产生电路阻塞一预定的周期(比方说，10分钟)。
图8示出了能够响应双重关断信号的转发器的一个例子。该转发器包括一个接收/发送天线110，天线的输出经二极管D1和D2送到一电源供电电容C1。当该电容C1充分充电时，该转发器电路即被启动，且该转发器按照如上所述的方式开始发送它的识别码。来自电容C1的供电启动了码产生器电路112和一个时钟产生器电路114，该电路114经电阻R接收一个“时钟启动”信号。通常由来自间隔检测逻辑电路116的一个“码启动”信号所启动而处于操作模式中的码产生器将它的输出送到一个调制器电路118，该调制器以由时钟产生器电路114所确定的一个时钟频率，将来自码产生器112的转发器识别码调制到查询信号上。
如果来自转发器的响应信号被查询器成功地检测，则在发送器时钟周期的N＋3和N＋8之间，该查询器发送如图7中所示的第一关断信号。在查询信号中的这一中断由间隔检测逻辑电路116所检测，并将“码启动”信号从码产生器中移除，阻塞该转发器。此时的间隔检测逻辑电路M6监视查询信号以找到如图7所示的出现于转发器时钟周期N＋10和N＋14之间的第二个关断信号。如果该第二个关断信号被检测到，该间隙检测逻辑电路116将一个开关控制信号送到一个可控开关S1，关闭该开关。这就使一个定时电容器CT经二极管D3充电。当该电容允至一预定充电电平时，它接通一个场效应晶体管T1，从时钟产生电路114除去“时钟启动”信号。这就阻塞了该转发器，并使该转发器保持在这种状态中直到它被从该查询器的场中移出为止。当这种情形发生时，定时电容CT经一并联泄漏电阻RL放电。一旦定时电容CT彻底放电，该转发器将会再次正常工作，并将响应查询信号。然而，假如在电容器CT仍然被充电时的任何时间，该转发器被移入一个查询场，该时钟产生器电路114将继续被阻塞，阻止转发器的操作。
图9更为详细地图示说明了图8中的间隙检测逻辑电路116。对应于图8中所示的输入和输出，该电路有两个输入和两个输出。这两个输入，一个是用于接收转发器时钟信号的“时钟”输入，一个是监视来自该查询器的已收到的RF电源出现的“RF电源”线。该电路的两个输出是，一个为输出到码产生器112的一个“码启动”，而另一个是用于控制可控开关S1的开关控制输出“SW控制”。
当电源初始加至间隙检测逻辑电路116上的时候，一个电源接通复位电路120将一复位信号加到一阻塞触发器122并复位一随机间隙产生器电路124。在一个伪随机延时之后，该随机间隙产生器电路124将一输出脉冲送到调制器启动触发器126，有效地改变了来自转发器的连续数据传输之间的间隔。在每一次从电源接通复位电路120接收复位信号时，在随机间隔产生电路中的一随机数字产生器都被激活。调制器启动触发器126被构形以便在一个复位状态中开始提供一个复位信号到一个帧长度计数器128，该计数器测量并控制着由码产生器112发送的码长度。
阻塞融发器122的Q输出被送到调制器启动触发器126的D输入。随机间隙产生器124以伪随机间隔产生出一个触发调制器启动触发器126的输出脉冲。如果这个触发器的D输入是高电平，它的Q输出变为高电平。这就起到一个“码启动”信号的作用，启动码产生器112。这一输出还被送到一个“与”门130，使得转发器时钟信号送至帧长度计数器时128，当码产生器112输出转发器的识别码序列时，帧长度计数器128对于每一个输入的时钟脉冲记录一个计数。在码序列的结束处，帧长度计数器溢出，将一个复位信号送到调制器启动触发器126。这就从调制器启动触发器126的Q输出端除去了“码启动”信号，并启动一个并行负载右移寄存器132，该寄存器除去第一位(图四中最左边位)是输入1以外，输入一个零序列。六个锁存触发器134至144中的每一个都是由来自帧长度计数器128的输出信号所复位的。
移位寄存器132的串联输入是以逻辑“零”被保持的，并且一个移位寄存器是如此设计的，即对于每一个时钟脉冲，输入的“1”都向右移一个位置。该移位寄存器的输出被如此连接，以使得以对应于图7的定时图的合适的时钟对锁存触发器进行时钟控制。锁存触发器134至144的D输入被连接到该电路的“RF电源”线，并且当“1”沿该移位寄存器传递而钟控合适的锁存器时，依照“RF电源”线的状态，这些锁存器记录一个“1”或一个“零”。
一旦查询器收到来自转发器的完好识别码并已经用一合适的中断或关断信号调制了查询信号时，锁存触发器134至144的状态将对应于预定的1和零的序列，该序列由包含反相器146和148的若干个门电路解码并多路输入到“与”门150和152。当正确的关断调制被接收，由与门150输出一个上升沿，该上升沿送到阻塞触发器122的时钟输入端，阻塞调制器启动触发器126的另外的触发。如果第二个关断信号被检测到，与门152的输出成高电平，产生出“SW信号”输出，并阻塞转发器的机载时钟产生器。
图10以一个流程图的方式示出了上述操作的转发器的操作情况。
上述参考图8和图9的技术也可以应用于防窃使用，本发明的转发器在此处被用来在零售出口“标记”商品目标。在这样一个应用中，在收款或结账台处的一个查询器将查询信号发送到有关商品的转发器，并且在它们被成功识别时，有效地将关断信号送到这些转发器。采用与图8和图9所描述的类似电路，该转发器被阻塞一预定的周期(比如说10分钟)。用户则经过一个出口，在该出口安置有第二个查询器。在结账处通过正确处理而已经被阻塞的那些查询器将不响应来自在出口处的查询器的查询信号。然而在被偷窃货品中的转发器将被出口处的查询器所检测，这可以产生一个适当的报警。
上面描述的转发器是相对完备且低价的，如上述那样，可被用于多种不同的目标。在多数情况下，不要求单一的查询器去识别与完全不同类型的目标相关联的转发器，例如，在超级市场中用于提货目的的一个查询器将不要求去识别汽车。如果要求每一个查询器去识别所有的可能的转发器，则就需要在该查询器中存储无法接受的大信息量，且查询器的有效处理将会变得繁杂。为对付这种局面，欲用于不同目标的类别的查询器和转发器被配置不同长度的码。比如说，用于汽车执照底板有效性的识别系统可配置有长度为24比特的码，这样，该码对于以22比特码操作的车辆注册码的相邻读取器就不能被理解为有效值。既使是这两个系统的转发器同时是发送它们的响应信号，在两个响应信号间的随机或伪随机延时将确保两个系统的转发器最终被收到。

Claims (21)

1、一个识别系统，包括一个查询器和多个转发器，该查询器包括有用于将一查询信号发送到转发器的发送器装置，用于从转发器接收响应信号的接收器装置，以及用于从响应信号中的数据识别转发器的处理器装置；每一转发器包括用于接收查询信号的接收器装置，一个转发器时钟产生器，一个码产生器，发送器装置连接到该码产生器的一个调制器，以便一经收到查询信号，该转发器即发出一个包含有识别该转发器的数据响应信号，该查询器被用来检测来自任一转发器的响应的成功的接收，从该转发器的响应信号提取同步信号，并且与该响应信号同步地修正该查询信号，以便指示响应信号的成功接收，每一个转发器都包含有对查询信号的各个修正作响应的装置，以停止其响应信号的传送。
2、如权利要求1的识别系统，其特征在于查询器包括用于从响应信号中提取一转发器时钟信号的时钟信号提取装置，该响应信号用来使查询信号的修正同步于来自转发器的响应信号。
3、如权利要求2的识别系统，其特征在于时钟提取装置被用来产生一个伪转发器时钟信号，该信号跟随被提取的转发器时钟信号的频率。
4、如权利要求3的识别系统，其特征在于时钟提取装置包括一个产生伪转发器时钟信号的压控振荡器，和已提取的时钟监视器装置，该监视器装置监视已提取的转发器时钟信号的出现并且在不存在已提取的转发器时钟信号的情况下，控制压控振荡器以保持伪转发器时钟信号的频率恒定。
5、如权利要求4的识别系统，其特征在于查询器包括定时基准装置，设置成产生一个控制压控振荡器的输出电压，当一个转发器响应信号被接收时，该输出电压开始与转发器响应信号中的一个同步码的值有关。
6、如权利要求5的识别系统，其特征在于定时基准装置被设置为产生一个电压斜坡，该斜坡电压所达到的电压值与在转发器响应信号中的同步比特的持续期相关。
7、如权利要求2—6的识别系统，其特征在于的查询器被用来将所说的查询信号修正一个转发器时钟信号周期的第一预定周期数，并在该查询器成功接收该转发器的响应信号之后，将所说的查询信号修正一个转发器时钟信号周期的第二预定周期数。
8、如权利要求7的识别系统，其特征在于的查询信号是通过中断而被修正。
9、如权利要求7的识别系统，其特征在于转发器包括逻辑电路，设置成监视查询信号的修正，并且仅在当查询信号的修正具有与转发器时钟周期的预定数目的持续期相关的一个持续期时，该逻辑电路才使该转发器停止响应信号的传送。
10、如权利要求9的识别系统，其特征在于转发器逻辑电路被设置成在对应于一个单一转发器时钟周期的一个周期上监视查询信号和修正。
11、如权利要求7的识别系统，其特征在于查询器至少第二次被用来将查询信号修正转发器时钟信号周期的一个第三预定数，并且在该查询器成功接收该转发器响应信号之后，将查询信号修正转发器时钟信号周期的一个第四预定数。
12、如权利要求11的识别系统，其特征在于转发器包括控制装置，设置成检测查询信号的第二次修正，并在该转发器停止接收查询信号之后，将转发器阻塞一个预定的时间。
13、如权利要求12的识别系统，其特征在于预定时间是由一个定时电路决定的，该定时电路包括一个充电存储装置，设置成由取自查询信号的电能充电，并在该转发器停止接收查询信号之后，以受控速率放电。
14、如权利要求1的识别系统，其特征在于查询信号的修正包括以一受控速率产生的过渡。
15、如权利要求1的识别系统，其特征在于响应于查询信号修正的装置被用来将转发器阻塞一预定的时间周期。
16、一个使用在权利要求1-15中任意一个权利要求的识别系统中的转发器，该转发器包括用于接收查询信号的接收器装置，一个转发器时钟产生器，一个码产生器，发送器装置，连接到该码产生器的一个调制器，以便一旦接收到查询信号，该转发器发送一个包含指示该转发器的数据的响应信号；该转发器进一步包括对与响应信号同步的各个查询信号的修正作响应的装置，该装置还指示来自其响应信号的转发器的成功的识别，以停止其响应信号的发送。
17、根据权利要求16的转发器，其特征在于转发器包括逻辑电路，设置成监视查询信号的修正，并仅在查询信号的修正具有与转发器时钟周期一预定数的持续期的相关的一个持续期的情况下，使得该转发器停止其响应信号的发送。
18、如权利要求17的转发器，其特征在于转发器逻辑电路设置成在对应于一单一转发器时钟周期上监视查询信号的修正。
19、如权利要求16-18中任意一个权利要求的转发器，其特征在于响应查询信号修正的装置被用来将转发器阻塞一预定的时间周期。
20、如权利要求16的转发器，其特征在于转发器包括控制装置，设置成检测查询信号的一个第二修正，并在该转发器停止接收查询信号之后，将转发器阻塞一预定的时间周期。
21、如权利要求19的转发器，其特征在于预定时间由包含一充电存储装置的定时电路决定，该充电存贮装置由来自查询信号的电能充电，并在该转发器停止接收查询信号之后，以受控的速率放电。
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