DE10358324A1 - Leistungstransistorzelle und Leistungstransistorbauelement mit Schmelzsicherung - Google Patents
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- 230000008018 melting Effects 0.000 claims abstract description 38
- 238000002844 melting Methods 0.000 claims abstract description 38
- 239000004020 conductor Substances 0.000 claims abstract description 37
- 239000004065 semiconductor Substances 0.000 claims description 35
- 239000000758 substrate Substances 0.000 claims description 23
- 239000010410 layer Substances 0.000 description 18
- 238000012360 testing method Methods 0.000 description 7
- 235000012431 wafers Nutrition 0.000 description 6
- 238000004519 manufacturing process Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 230000015572 biosynthetic process Effects 0.000 description 4
- 230000015556 catabolic process Effects 0.000 description 4
- 230000002950 deficient Effects 0.000 description 4
- 239000012212 insulator Substances 0.000 description 4
- 230000007547 defect Effects 0.000 description 3
- 238000001465 metallisation Methods 0.000 description 3
- 230000000284 resting effect Effects 0.000 description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 2
- 238000009826 distribution Methods 0.000 description 2
- 238000005530 etching Methods 0.000 description 2
- 230000005669 field effect Effects 0.000 description 2
- 239000011229 interlayer Substances 0.000 description 2
- 229910052814 silicon oxide Inorganic materials 0.000 description 2
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 1
- 230000002411 adverse Effects 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000005137 deposition process Methods 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000018109 developmental process Effects 0.000 description 1
- 239000003989 dielectric material Substances 0.000 description 1
- 239000012777 electrically insulating material Substances 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 239000000155 melt Substances 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 230000035945 sensitivity Effects 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7801—DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
- H01L29/7802—Vertical DMOS transistors, i.e. VDMOS transistors
- H01L29/7813—Vertical DMOS transistors, i.e. VDMOS transistors with trench gate electrode, e.g. UMOS transistors
-
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/525—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body with adaptable interconnections
- H01L23/5256—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body with adaptable interconnections comprising fuses, i.e. connections having their state changed from conductive to non-conductive
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- H01—ELECTRIC ELEMENTS
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- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/417—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions carrying the current to be rectified, amplified or switched
- H01L29/41725—Source or drain electrodes for field effect devices
- H01L29/41766—Source or drain electrodes for field effect devices with at least part of the source or drain electrode having contact below the semiconductor surface, e.g. the source or drain electrode formed at least partially in a groove or with inclusions of conductor inside the semiconductor
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/42356—Disposition, e.g. buried gate electrode
- H01L29/4236—Disposition, e.g. buried gate electrode within a trench, e.g. trench gate electrode, groove gate electrode
-
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/42372—Gate electrodes for field effect devices for field-effect transistors with insulated gate characterised by the conducting layer, e.g. the length, the sectional shape or the lay-out
- H01L29/42376—Gate electrodes for field effect devices for field-effect transistors with insulated gate characterised by the conducting layer, e.g. the length, the sectional shape or the lay-out characterised by the length or the sectional shape
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/42372—Gate electrodes for field effect devices for field-effect transistors with insulated gate characterised by the conducting layer, e.g. the length, the sectional shape or the lay-out
- H01L29/4238—Gate electrodes for field effect devices for field-effect transistors with insulated gate characterised by the conducting layer, e.g. the length, the sectional shape or the lay-out characterised by the surface lay-out
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- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7801—DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
- H01L29/7802—Vertical DMOS transistors, i.e. VDMOS transistors
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
-
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/30—Technical effects
- H01L2924/301—Electrical effects
- H01L2924/3011—Impedance
Abstract
Transistorzellen (2) eines Leistungstransistorbauelements werden jeweils mit einer Gateleiterstruktur vorgesehen, die abschnittsweise eine Gateelektrode (52) ausbildet und über einen Gate-Zellenanschluss (43) mit einer zu einem Gate-Anschluss (44) des Leistungstransistorbauelements (1) geführten Gateverdrahtungsleitung (81) verbunden ist. Die Gateleiterstruktur (5) weist einen Sollschmelzabschnitt (51) mit erhöhtem Widerstandswert auf, der innerhalb eines Hohlraums angeordnet ist. Der Widerstandswert des Sollschmelzabschnitts (51) ist so einstellbar, dass bei einer Strombelastung in Höhe eines für ein fehlerhaftes Gatedielektrikum (41) typischen Werts der Gateleiterabschnitt (5) im Sollschmelzabschnitt (51) unterbrochen und die Gateelektrode (52) von der Gateverdrahtungsleitung (81) abgetrennt wird. Das Leistungstransistorbauelement lässt sich mit hoher Ausbeute fertigen und weist im Anwendungsbetrieb eine geringe Zahl von Ausfällen auf.
Description
- Leistungstransistorzelle und Leistungstransistorbauelement mit Schmelzsicherung
- Die Erfindung bezieht sich auf eine Leistungstransistorzelle mit einem Gate-Zellenanschluss und einer mit dem Gate-Zellenanschluss verbundenen Gateleiterstruktur mit einem an ein Gatedielektrikum anschließenden Elektrodenabschnitt zur Steuerung der Leistungstransistorzelle, sowie auf ein Leistungstransistorbauelement mit Schmelzsicherung.
- Leistungshalbleiterbauelemente sind aus einer Vielzahl im Wesentlichen identischer Transistorzellen aufgebaut, die zur Erhöhung der Stromtragfähigkeit des Leistungshalbleiterbauelements oft zu mehreren Zehntausend parallel geschaltet sind. Bei modernen, vertikal strukturierten Leistungshalbleiterbauelementen ist dabei die Gateelektrode jeweils einer Transistorzelle in einem in ein Halbleitersubstrat eingebrachten Graben (trench) vorgesehen, so dass durch die Gateelektrode ein vertikaler leitfähiger Kanal zwischen zwei einander am Halbleitersubstrat gegenüberliegenden Source- bzw. Drain-Anschlussbereichen steuerbar ist. Die Gateelektroden der Transistorzellen eines Leistungshalbleiterbauelements, etwa eines vertikalen MOSFETs (metall oxide semiconducter field effect transistor) oder eines IGBTs (insulated gate bipolar transistor) sind parallel geschaltet.
- Die Funktionalität des Leistungshalbleiterbauelements ist in der Regel nur dann gewährleistet, wenn das Gatedielektrikum aller Transistorzellen eines Leistungshalbleiterbauelements funktionstüchtig ist. Ein Kurzschluss zwischen der Gateelektrode und dem Source- bzw. Drain-Gebiet einer Transistorzelle führt zum Ausfall des gesamten Leistungshalbleiterbau elements. Da Leistungshalbleiterbauelemente als so genannte Leistungsmodule innerhalb eines Modulgehäuses zu einer Mehrzahl parallel geschaltet sind, potenzieren sich die Anforderungen an die Zuverlässigkeit der Ausbildung des Gatedielektrikums.
- Ein einzelner Defekt im Gatedielektrikum kann entweder am Ende der Fertigung oder nach längerer Betriebszeit des Leistungshalbleiterbauelements zum Ausfall des Bauelements führen.
- Um die kritischeren Ausfälle im Anwendungsbetrieb der Leistungshalbleiterbauelemente gering zu halten, werden die Leistungshalbleiterbauelemente einem Stresstest unterzogen, in dessen Zuge die Qualität bzw. Fehlerträchtigkeit des Bauelements geprüft wird. Dazu wird in der Regel auf Waferebene eine gegenüber den Betriebsspannungen deutlich erhöhte Stress-Spannung zwischen der Gateelektrode und dem Source- bzw. Drain-Anschluss angelegt, um Transistorzellen mit einem fehlerhaften Gatedielektrikum bereits im Prüffeld zum Ausfall zu bringen. Die Höhe der Stress-Spannung ist durch die intrinsischen Durchbruchsspannung des Gatedielektrikums begrenzt, da oberhalb der intrinsischen Durchbruchsspannung Ladungen ins Gatedielektrikum eingeprägt werden, die ihrerseits die Lebensdauer des Gatedielektrikums mindern.
- Ferner ist bekannt, dass Leistungshalbleiterbauelemente von Wafern oder aus Losen von Wafern, für die ein breites Verteilungsband der Durchbruchsspannung ermittelt wird, mit höherer Wahrscheinlichkeit zu Frühausfällen im Anwendungsbetrieb neigen als Leistungshalbleiterbauelemente von Wafern bzw. aus Losen mit einem schmalen Verteilungsband der Durchbruchsspannung. Um Frühausfälle im Anwendungsbetrieb soweit als möglich auszuschließen, werden solche Wafer oder auch Lose solcher Wafer komplett verworfen. Dadurch wird die Fertigungsausbeute deutlich reduziert.
- Darüber hinaus sind aufwendige Untersuchungen zur tatsächlichen Ausbildung des Gatedielektrikums in Form von Stichproben innerhalb eines Monitorings notwendig, da sich aus dem Ergebnis des Stresstests nicht unbedingt auf die Dichte von Fehlstellen (Defektdichte) im Gatedielektrikum zurückschließen lässt.
- Es sind daher verschiedene Ansätze bekannt, durch nachträgliches Abtrennen fehlerhafter Speicherzellen die Ausbeute an fehlerfrei gefertigten Leistungshalbleiterbauelementen zu erhöhen.
- Etwa ist es bekannt, Transistorzellen von MOS-Leistungsfeldeffekttransistoren zu Zellenblöcken (cell blocks) zu gruppieren und die Zellen oder auch Zellenblöcke einzeln zu prüfen. In einem folgenden Prozess werden nur diejenigen Zellenblöcke, die sich in der Prüfung als fehlerfrei erwiesen haben, mit dem Source- bzw. mit dem Drain-Anschluss des Leistungshalbleiterbauelements verbunden.
- Aus der
US 5,021,861 ist ein Zellenkonzept für Leistungshalbleiterbauelemente bekannt, bei dem eine Schmelzsicherung (fusible link) zwischen dem Gate-Anschluss des Leistungshalbleiterbauelements und dem Gate-Anschluss jedes Zellenblocks vorgesehen ist. Die Schmelzsicherung ist dabei so ausgelegt, dass ein Kurzschluss im Zellenblock zum Aufschmelzen der Schmelzsicherung führt. Jeder Zellenblock, der eine oder mehrere defekte Zellen aufweist, wird isoliert, indem die Verbindung des Gate-Anschlusses des Zellenblocks zum Gate-Anschluss des Leistungshalbleiterbauelements aufgetrennt wird. - Nachteilig an diesem Konzept ist die mangelnde Empfindlichkeit der Schmelzsicherung, da einerseits bereits sehr geringe Gate-Leckströme auf eine fehlerhafte Transistorzelle hinweisen, andererseits die Schmelzsicherung robust genug sein muss, um den zulässigen Gatestrom aller im Zellenblock parallel geschalteter Zellen aufzunehmen.
- In der
US 5,446,310 wird daher vorgeschlagen, in einem ersten Schritt die Stromaufnahme an der Gateelektrode einzelner Zellenblöcke zu ermitteln und in einem zweiten Schritt durch eine externe Stromquelle entsprechende, den Zellenblöcken zugeordnete Schmelzsicherungen abhängig vom vorangegangenen Prüfungsergebnis aufzuschmelzen. - Dabei ist zunächst der erhöhte Aufwand im Prüffeld nachteilig sowie der Umstand, dass die Schmelzsicherungen nur im Prüffeld, nicht aber im fertigen, gehäusten Bauelement aufgeschmolzen werden können. Ferner wird durch das Abhängen ganzer Zellenblöcke die Stromtragfähigkeit des Leistungshalbleiterbauelements deutlich verringert und die Belastung der verbleibenden Zellenblöcke erhöht. Durch die Zuordnung jeweils einer Schmelzsicherung zu einer Mehrzahl von in einem Zellenblock gruppierten Transistorzellen werden in der Regel neben der defekten Transistorzelle selbst auch eine Reihe an sich funktionstüchtiger Transistorzellen abgehängt und die Stromtragfähigkeit des Leistungshalbleiterbauelements in größerem Umfang reduziert als erforderlich.
- Der Erfindung liegt daher die Aufgabe zugrunde, eine Transistorzelle bzw. ein Leistungstransistorbauelement mit hoher Zuverlässigkeit zur Verfügung zu stellen, für die bzw. das eine hohe Ausbeute in der Herstellung gewährleistet wird.
- Die Aufgabe wird durch eine Transistorzelle der eingangs genannten Art mit den im kennzeichnenden Teil des Patentanspruchs 1 genannten Merkmalen sowie durch die Leistungstransistorbauelemente nach den Patentansprüchen 9 und 11 gelöst. Vorteilhafte Weiterbildungen ergeben sich aus den jeweils zugeordneten Unteransprüchen.
- Eine Leistungstransistorzelle weist einen Gate-Zellenanschluss auf. Über den Gate-Zellenanschluss sind eine Mehrzahl von Leistungstransistorzellen eines Leistungstransistorbauelements an eine Gateverdrahtungsleitung angeschlossen. Die Gateverdrahtungsleitung ist an einen Gate-Anschluss des Leistungstransistorbauteils geführt. Die Leistungstransistorzelle weist zudem eine Gateleiterstruktur auf, die mit dem Gate-Zellenanschluss verbunden ist und einen an ein Gatedielektrikum anschließenden Elektrodenabschnitt aufweist.
- Erfindungsgemäß weist die Gateleiterstruktur mindestens einen innerhalb eines Hohlraums angeordneten Sollschmelzabschnitt auf. Der Sollschmelzabschnitt wird bei einem Überschreiten eines maximal zulässigen Stromflusses durch den Sollschmelzabschnitt der Gateleiterstruktur durch thermische Erwärmung aufgeschmolzen. Die Verbindung des Elektrodenabschnitts der Gateleiterstruktur zum Gate-Zellenanschluss ist nach dem Aufschmelzen des Sollschmelzabschnitts unterbrochen.
- Bei üblichen Schmelzsicherungen, die vollständig innerhalb einer die Schmelzsicherung umgebenden Isolatorschicht ausgeführt sind, sind nur etwa 1 bis 10 % der Zündenergie für das Aufschmelzen des Sollschmelzabschnitts selbst erforderlich, während der weitaus überwiegende Teil der Zündenergie als Wärme in die umgebende Isolatorschicht abgeführt wird. Durch das Anordnen eines Sollschmelzabschnitts innerhalb eines Hohlraums wird die Zündenergie um den Faktor 10 bis 100 ver ringert. Eine solche Schmelzsicherung für programmierbare Speicherzellen ist etwa aus der
DE 196 00 398 C1 bekannt. Die vergleichsweise geringe Zündenergie einer Hohlraum-Schmelzsicherung ermöglicht das Zünden der Schmelzsicherung durch eine einzelne defekte Transistorzelle. - In der Folge ist die Herstellung von Leistungstransistorbauelementen möglich, deren Transistorzellen jeweils eine eigene Schmelzsicherung zugeordnet ist. Gegenüber bekannten Anordnungen ergibt sich in vorteilhafter Weise eine erhöhte Fertigungsausbeute dadurch, dass weniger Bauteile auf Verdacht verworfen werden müssen. Die Schmelzsicherung der erfindungsgemäßen Transistorzelle ist auch im Anwendungsbetrieb des Leistungshalbleiterbauelements aktivierbar, so dass die Zuverlässigkeit im Feld deutlich verbessert ist.
- Neben einer als Abschnitt der Gateleiterstruktur ausgebildeten Gateelektrode umfasst die Leistungstransistorzelle ein aktives Gebiet mit einem Source-Gebiet, einem um ein Drift-Gebiet erweiterten Drain-Gebiet sowie einem zwischen dem Source- Gebiet und dem Drain-Gebiet angeordneten Body-Gebiet. Durch ein Potential an der Gateelektrode ist die Ausbildung eines leitfähigen Kanals zwischen dem Source- und dem Drain-Gebiet steuerbar. Das aktive Gebiet ist in einem Halbleitersubstrat ausgebildet.
- In einer bevorzugten Ausführungsform weist die erfindungsgemäße Leistungstransistorzelle eine Gateleiterstruktur auf, deren Sollschmelzabschnitt auf bzw. über der Substratoberfläche des Halbleitersubstrats angeordnet ist und sich planar in einer zur Substratoberfläche horizontalen Ebene erstreckt. Der Sollschmelzabschnitt ist dabei über oder neben dem aktiven Gebiet der Leistungstransistorzelle vorgesehen. Die horizontalen Abmessungen wie Länge und Breite des Sollschmelzab schnitts können durch ein lithographisches Verfahren oder mit üblichen sublithographischen Ätzstrukturierverfahren eingestellt werden.
- Bevorzugt ist die Leistungstransistorzelle als vertikale Leistungstransistorzelle ausgebildet, wobei die Gateelektrode als Abschnitt der Gateleiterstruktur in einem in ein Halbleitersubstrat eingebrachten Gate-Graben (gate trench) vorgesehen ist. Der leitfähige Kanal zwischen dem Source- und dem Drain-Bereich wird im Wesentlichen in einer zur Substratoberfläche senkrechten Richtung ausgebildet.
- Bei einer Leistungstransistorzelle mit im Gate-Graben ausgebildeter Gateelektrode ist der Sollschmelzabschnitt der Gateleiterstruktur durch einen als konforme Schicht gleichmäßiger Schichtdicke mindestens abschnittsweise an Seitenwänden des Gate-Grabens angeordneten Abschnitt der Gateleiterstruktur vorgesehen.
- Die Schichtdicke der konformen Schicht ist dabei so bemessen, dass der nicht von der konformen Schicht gefüllte Anteil des Gate-Grabens den dem Sollschmelzabschnitt zugeordneten Hohlraum ausbildet. Für den Hohlraum selbst ist dann in vorteilhafter Weise kein zusätzlicher Ätzschritt notwendig. Ferner sind in vorteilhafter Weise die Hohlräume selbstjustiert zu den Sollschmelzabschnitten ausgebildet.
- Außerhalb des Sollschmelzabschnitts ist eine möglichst niederohmige Gateleiterstruktur zur Wahrung der Funktionalität der Leistungstransistorzelle erforderlich, um beispielsweise ausreichend schnelle Ein- und Ausschaltzeiten zu gewährleisten.
- Nach einer bevorzugten Ausführungsform der erfindungsgemäßen Leistungstransistorzelle mit einem als konforme Schicht innerhalb des Gate-Grabens vorgesehenen Sollschmelzabschnitt ist der Öffnungsbereich des Gate-Grabens durch eine Hilfsstruktur abgedeckt. Die Hilfsstruktur weist eine Zuführungsöffnung zum Gate-Graben auf, deren Querschnitt geringer ist als der Öffnungsbereich des Gate-Grabens. Durch den Querschnitt der Zuführungsöffnung wird bei einer konformen Abscheidung der Gateleiterstruktur die Schichtdicke der Gateleiterstruktur bzw. der Gateelektrode im Innern des Gate-Grabens durch die halbe Weite der Zuführungsöffnung bestimmt. Der Sollschmelzabschnitt kann auch Teile der Gateelektrode umfassen bzw. teilweise oder vollständig mit dem Elektrodenabschnitt der Gateleiterstruktur identisch sein.
- Die Hilfsstruktur wird aus einem dielektrischen Material, etwa einem Oxid wie etwa Siliziumoxid, gebildet. Die Justierung der Zuführungsöffnung zur Grabenöffnung ist vergleichsweise unkritisch. Oberhalb der Zuführungsöffnung kann die Gateleiterstruktur von der Schichtdicke des Sollschmelzabschnitts entkoppelt im Zuge des gleichen Abscheidungsprozesses in der erforderlichen Schichtdicke vorgesehen werden.
- Nach einem alternativen Ausführungsbeispiel der erfindungsgemäßen Leistungstransistorzelle wird der Gate-Graben mit einem sich zur Grabenöffnung hin verkleinernden Querschnitt vorgesehen. Durch den Querschnitt des Öffnungsbereichs des Gate-Grabens wird die Schichtdicke der Gateleiterstruktur in einem an den Öffnungsbereich des Gate-Grabens anschließenden unteren Abschnitt des Gate-Grabens bestimmt.
- Nach einer weiteren bevorzugten Ausführungsform der erfindungsgemäßen Leistungstransistorzelle ist der Öffnungsbereich des Gate-Grabens durch eine Hilfskammerstruktur abgedeckt, die eine Zuführungsöffnung aufweist. Die Zuführungsöffnung ist abschnittsweise mit einem kleinen Querschnitt vorgesehen, durch den die Schichtdicke des Sollschmelzabschnitts vorgegeben ist. Die Gateleiterstruktur wird von einem oberhalb der Hilfskammerstruktur vorgesehenen Abschnitt der Gateleiterstruktur durch die Zuführungsöffnung zu der unterhalb der Hilfskammerstruktur angeordneten Gateelektrode im Gate-Graben geführt.
- Die Zuführungsöffnung weist ferner Abschnitte mit erweitertem Querschnitt auf, durch die der dem Sollschmelzabschnitt zugeordnete Hohlraum ausgebildet ist.
- Bevorzugt ist dabei der Hohlraum in einem mittleren Abschnitt der Zuführungsöffnung ausgebildet.
- Das erfindungsgemäße Leistungstransistorbauelement weist einen Gate-Anschluss und eine Mehrzahl von parallel geschalteten Transistorzellen auf. Die Gateelektroden der Transistorzellen sind über eine Gateverdrahtungsleitung jeweils mit dem Gate-Anschluss des Leistungstransistorbauelements verbunden.
- Erfindungsgemäß ist mindestens eine Teilmenge der Transistorzellen jeweils mit einer Gateleiterstruktur mit einem Sollschmelzabschnitt vorgesehen, der innerhalb eines Hohlraums angeordnet ist.
- In bevorzugter Weise sind alle Transistorzellen des Leistungstransistorbauelements entsprechend einer der oben beschriebenen Transistorzellen ausgebildet.
- Ein weiteres erfindungsgemäßes Leistungstransistorbauelement weist einen Gate-Anschluss und eine mit dem Gate-Anschluss verbundene Gateverdrahtungsleitung auf. Eine Mehrzahl von Zellenblöcken mit parallel geschalteten Transistorzellen mit jeweils einer Gateleiterstruktur mit einem Elektrodenabschnitt weist jeweils einen mit den Gateleiterstrukturen der Transistorzellen des Zellenblocks verbundenen Gate-Zellenblockanschluss auf. Zwischen jeweils einem der Gate-Zellenblockanschlüsse und der Gateverdrahtungsleitung sind Schmelzsicherungseinrichtungen vorgesehen.
- Erfindungsgemäß sind die Schmelzsicherungseinrichtungen jeweils in einem Hohlraum einer Isolatorstruktur angeordnet.
- Nachfolgend werden die Erfindung und deren Vorteile anhand von Figuren näher erläutert, wobei einander entsprechende Komponenten mit denselben Bezugszeichen bezeichnet sind. Es zeigen:
-
1 eine schematische Draufsicht auf zwei Transistorzellen eines Leistungstransistorbauelements nach einem ersten Ausführungsbeispiel der Erfindung mit einem Gateleiterabschnitt mit planar ausgebildetem Sollschmelzabschnitt, -
2 einen schematischen Querschnitt durch eine Leistungstransistorzelle nach einem zweiten Ausführungsbeispiel mit einer in einer Hilfsstruktur vorgesehenen Zuführungsöffnung zum Gate-Graben, -
3 einen schematischen Querschnitt durch eine Leistungstransistorzelle nach einem dritten Ausführungsbeispiel mit einem Gate-Graben mit verringerten Öffnungsquerschnitt und -
4 einen schematischen Querschnitt durch eine Leistungstransistorzelle nach einem vierten Ausführungsbei spiel mit einer oberhalb des Gate-Grabens vorgesehenen Hilfskammerstruktur. - Das in der
1 dargestellte Leistungstransistorbauelement1 weist eine Mehrzahl einander im Wesentlichen identischer Leistungstransistorzellen2 auf. Jede Leistungstransistorzelle wird durch ein in einem Halbleitersubstrat ausgebildetes aktives Gebiet3 definiert, das mindestens ein Source-, ein Drain- und ein Bodygebiet umfasst. Zum aktiven Gebiet3 ist eine Gateleiterstruktur5 geführt, die abschnittsweise im Bereich des aktiven Gebiets3 eine Gateelektrode ausbildet. Jeder Transistorzelle2 ist ein Gate-Zellenabschluss43 zugeordnet. Eine Gateverdrahtungsleitung81 verbindet die Gate-Zellenanschlüsse43 mit einem Gate-Anschluss44 des Leistungstransistorbauelements1 . Die Gateleiterstruktur5 weist in einem Sollschmelzabschnitt51 eine Querschnittsverengung auf. Der Sollschmelzabschnitt51 ist auf dem Halbleitersubstrat in einem Hohlraum6 einer die Gateleiterstruktur5 abdeckenden Isolatorschicht ausgebildet. - Weist eine Transistorzelle
2 ein fehlerhaftes Gatedielektrikum auf, so fließt im Bereich der fehlerhaften Transistorzelle2 zwischen dem Gate-Anschluss44 und einem Source- oder Drain-Anschluss des Leistungstransistorbauelements1 ein Fehlerstrom. Im Bereich des Sollschmelzabschnitts51 führt ein Fehlerstrom, der kennzeichnend für ein fehlerhaftes Gatedielektrikum ist, zum Aufschmelzen der Gateleiterstruktur5 im Sollschmelzabschnitt51 . In der Folge ist die Gateelektrode der Transistorzelle2 von der Gateverdrahtungsleitung81 isoliert. Die isolierte Transistorzelle2 ist inaktiv und kann nicht mehr zum Ausfall des Leistungstransistorbauelements1 beitragen. - Die
2 zeigt eine Leistungstransistorzelle mit Gate-Graben. Der Gate-Graben4 ist von einer Substratoberfläche30 her in ein Halbleitersubstrat84 eingebracht. Im Halbleitersubstrat84 sind jeweils als dotierte Gebiete ein Sourcegebiet31 anschließend an die Substratoberfläche30 , unterhalb des Sourcegebietes31 ein Bodygebiet32 und im Anschluss an das Bodygebiet32 ein Driftgebiet33 eines Draingebiets ausgebildet. Ein Gatedielektrikum41 isoliert eine innerhalb des Gate-Grabens4 als Elektrodenabschnitt einer Gateleiterstruktur5 ausgebildete Gateelektrode52 gegen das den Gate-Graben4 umfangende Halbleitersubstrat84 im Wesentlichen im Bereich des Bodygebiets32 . - Die Gateelektrode bzw. der Elektrodenabschnitt
52 der Gateleiterstruktur5 ist als Schicht gleichmäßiger Dicke als Auskleidung des Gate-Grabens4 vorgesehen. Im Bereich der Öffnung des Gate-Grabens4 liegt auf der Substratoberfläche30 eine Hilfsstruktur71 aus einem elektrisch isolierenden Material, etwa Siliziumoxid, auf. Die Hilfsstruktur71 weist oberhalb des Gate-Grabens4 eine Zuführungsöffnung72 auf, durch die die Gateleiterstruktur5 aus dem Gate-Graben4 an die Oberkante der Hilfsstruktur71 geführt ist. Oberhalb der Hilfsstruktur71 bildet die Gateleiterstruktur5 einen Gate-Zellenanschluss43 aus oder schließt unmittelbar oberhalb der Zuführungsöffnung72 an eine aufliegende Gateverdrahtungsleitung an. Ein Zwischenlagen-Dielektrikum82 isoliert durch die oberhalb der Hilfsstruktur7l angeordneten Abschnitte der Gateleiterstruktur5 ausgebildete Abschnitte einer Gateverdrahtungsleitung gegen eine aufliegende Metallisierung83 . Die Metallisierung83 verbindet die Sourcegebiete31 über ein Anschlussgebiet34 mit erhöhter Dotierung mit einem Source-Anschluss des Leistungstransistorbauelements. - Die Gateleiterstruktur
5 von Transistorzellen, deren Gate-Gräben in der Art von Lochgräben ausgebildet sind, weist im oberen Bereich des Gate-Grabens4 den kleinsten Querschnitt auf. Durch den Bereich des kleinsten Querschnitts wird ein Sollschmelzabschnitt51 der Gateleiterstruktur5 definiert. Der nicht vom Material der Gateleiterstruktur5 gefüllte Anteil des Gate-Grabens4 bildet einen Hohlraum6 aus. Im Falle eines Kurzschlussstroms zwischen der Gateleiterstruktur5 und dem Sourcegebiet31 oder dem Bodygebiet32 bzw. dem Driftgebiet33 wird die Gateleiterstruktur5 im Sollschmelzabschnitt51 in Folge des vergleichsweise hohen Widerstands am schnellsten erhitzt. Da der Sollschmelzabschnitt51 innerhalb des Hohlraums6 angeordnet ist, wird die erzeugte wärme schlecht abgeführt. Bei geeigneter Wahl der Schichtdicke der Gateleiterstruktur5 innerhalb des Gate-Grabens4 sowie des durch Dotierung einstellbaren spezifischen Widerstandes der Gateleiterstruktur5 schmilzt die Gateleiterstruktur5 im Sollschmelzabschnitt51 auf, so dass die Kurzschlussstrecke unterbrochen wird. Die Transistorzelle wird deaktiviert. - Im Unterschied zum Gate-Graben der in der
2 dargestellten Transistorzelle weist der Gate-Graben4 der in der3 im Querschnitt dargestellten Transistorzelle2 einen sich in Richtung der Substratoberfläche30 verjüngenden Querschnitt auf. Eine solche Ausbildung des Gate-Grabens4 lässt sich etwa durch einen Annealprozess in einer Wasserstoffatmosphäre erzielen. Entsprechend entfällt die Notwendigkeit zum Vorsehen einer Hilfsstruktur71 . Die Zuführungsöffnung72 ist ohne zusätzlichen lithographischen Prozess selbstjustiert zum Gate-Graben4 . - Die Schichtdicke der Gateleiterstruktur
5 innerhalb des Gate-Grabens4 und damit die Schichtdicke des Sollschmelzab schnitts51 der Gateleiterstruktur5 ist über die Weite der Zuführungsöffnung72 einstellbar. - Im in der
4 dargestellten Ausführungsbeispiel ist der Gate-Graben4 der Transistorzelle2 vollständig mit einer als Elektrodenabschnitt52 einer Gateleiterstruktur5 ausgebildeten Gateelektrode gefüllt. Der Sollschmelzabschnitt51 ist im Bereich einer im Bereich des Gate-Grabens4 auf der Substratoberfläche30 aufliegenden Hilfskammerstruktur73 ausgebildet. Die Hilfskammerstruktur73 weist eine Zuführungsöffnung74 auf, die eine auf der Hilfskammerstruktur73 aufliegende Gateverdrahtungsleitung bzw. einen auf der Hilfskammerstruktur73 aufliegenden Abschnitt der Gateleiterstruktur5 mit der im Inneren des Gate-Grabens4 angeordneten Gateelektrode52 verbindet. Die Zuführungsöffnung74 weist abschnittsweise einen kleinen Querschnitt auf, durch den die Schichtdicke bzw. der Querschnitt des Sollschmelzabschnitts51 der Gateleiterstruktur5 einstellbar ist. Ferner weist die Zuführungsöffnung74 der Hilfskammerstruktur73 einen mittleren Abschnitt auf, in dem der Querschnitt der Zuführungsöffnung größer ist als der Querschnitt des durch die Zuführungsöffnung74 geführten Abschnitts der Gateleiterstruktur5 . Der Abschnitt der Zuführungsöffnung74 mit dem erweiterten Querschnitt bildet den dem Sollschmelzabschnitt51 zugeordneten Hohlraum6 aus. -
- 1
- Leistungstransistorbauelement
- 2
- Transistorzelle
- 3
- aktives Gebiet
- 30
- Substratoberfläche
- 31
- Sourcegebiet
- 32
- Bodygebiet
- 33
- Driftgebiet
- 34
- Anschlussgebiet
- 4
- Gate-Graben
- 40
- Seitenwände
- 41
- Gatedielektrikum
- 44
- Gate-Anschluss
- 43
- Gate-Zellenanschluss
- 5
- Gateleiterstruktur
- 51
- Sollschmelzabschnitt
- 52
- Elektrodenabschnitt
- 6
- Hohlraum
- 6'
- Hohlraum
- 71
- Hilfsstruktur
- 72
- Zuführungsöffnung
- 73
- Hilfskammerstruktur
- 74
- Zuführungsöffnung
- 81
- Gateverdrahtungsleitung
- 82
- Zwischenlagen-Dielektrikum
- 83
- Metallisierung
- 84
- Halbleitersubstrat
Claims (11)
- Leistungstransistorzelle mit einem Gate-Zellenanschluss (
43 ) und einer mit dem Gate-Zellenanschluss (43 ) verbundenen Gateleiterstruktur (5 ) mit einem an ein Gatedielektrikum (41 ) anschließenden Elektrodenabschnitt (52 ) zur Steuerung der Leistungstransistorzelle, dadurch gekennzeichnet, dass die Gateleiterstruktur (5 ) zwischen dem Elektrodenabschnitt (52 ) und dem Gate-Zellenanschluss (43 ) einen innerhalb eines Hohlraums (6 ) angeordneten Sollschmelzabschnitt (51 ) aufweist, wobei die Stromtragfähigkeit des Sollschmelzabschnitts (51 ) so bemessen ist, dass die Gateleiterstruktur (5 ) bei einem für ein fehlerhaftes Gatedielektrikum (41 ) charakteristischen Stromfluss im Sollschmelzabschnitt (51 ) zu unterbrechen ist. - Leistungstransistorzelle nach Anspruch 1, dadurch gekennzeichnet, dass der Sollschmelzabschnitt (
51 ) der Gateleiterstruktur (5 ) planar auf einer Substratoberfläche (30 ) eines ein aktives Gebiet (3 ) der Leistungstransistorzelle (2 ) ausbildenden Halbleitersubstrats (84 ) angeordnet ist. - Leistungstransistorzelle nach einem der Ansprüche 1 bis 2, dadurch gekennzeichnet, dass der Elektrodenabschnitt (
52 ) der Gateleiterstruktur (5 ) in einem in ein Halbleitersubstrat (84 ) eingebrachten Gate-Graben (4 ) ausgebildet ist. - Leistungstransistorzelle nach Anspruch 3, dadurch gekennzeichnet, dass – der Sollschmelzabschnitt (
51 ) durch einen als konforme Schicht gleichmäßiger Schichtdicke mindestens abschnitts weise an Seitenwänden des Gate-Grabens (4 ) angeordneten Abschnitt der Gateleiterstruktur (5 ) und – der Hohlraum (6 ) durch einen nichtgefüllten inneren Abschnitt des Gate-Grabens (4 ) ausgebildet ist. - Leistungstransistorzelle nach Anspruch 4, dadurch gekennzeichnet, dass der Öffnungsbereich des Gate-Grabens (
4 ) mit einem geringeren Querschnitt als ein an den Öffnungsbereich anschließender unterer Abschnitt des Gate-Grabens (4 ) vorgesehen und durch den Querschnitt des Öffnungsbereichs des Gate-Grabens (4 ) die Schichtdicke der Gateleiterstruktur (5 ) innerhalb des Gate-Grabens (4 ) bestimmt ist. - Leistungstransistorzelle nach Anspruch 3, dadurch gekennzeichnet, dass – der Öffnungsbereich des Gate-Grabens (
4 ) durch eine Hilfsstruktur (71 ) mit einer Zuführungsöffnung (72 ) mit einem geringeren Querschnitt als dem des Gate-Grabens (4 ) abgedeckt, – die Gateleiterstruktur (5 ) durch die Zuführungsöffnung (71 ) geführt und – durch den Querschnitt der Zuführungsöffnung (71 ) die Schichtdicke der Gateleiterstruktur (5 ) innerhalb des Gate-Grabens (4 ) bestimmt ist. - Leistungstransistorzelle nach Anspruch 3, dadurch gekennzeichnet, dass – der Öffnungsbereich des Gate-Grabens (
4 ) durch eine Hilfskammerstruktur (73 ) mit einer Zuführungsöffnung (74 ) abgedeckt, – die Zuführungsöffnung (74 ) abschnittsweise mit einem kleinen, die Schichtdicke des Sollschmelzabschnitts (51 ) bestimmenden Querschnitt vorgesehen, – die Gateleiterstruktur (5 ) in einer durch den kleinen Querschnitt definierten Schichtdicke durch die Zuführungsöffnung (71 ) geführt und – der Hohlraum (6 ) durch Abschnitte der Zuführungsöffnung (73 ) mit erweitertem Querschnitt vorgesehen ist. - Leistungstransistorzelle nach Anspruch 7, dadurch gekennzeichnet, dass der Hohlraum (
6 ) in einem mittleren Abschnitt der Zuführungsöffnung (74 ) ausgebildet ist. - Leistungstransistorbauelement mit – einem Gate-Anschluss (
44 ), – mit einer Mehrzahl von parallel geschalteten Transistorzellen (2 ) mit jeweils einer über eine Gateverdrahtungsleitung (81 ) mit dem Gate-Anschluss (44 ) verbundenen Gateleiterstruktur (5 ) mit einem Elektrodenabschnitt (52 ) und – zwischen den Elektrodenabschnitten (52 ) und dem Gate-Anschluss (44 ) vorgesehenen Schmelzsicherungseinrichtungen, dadurch gekennzeichnet, dass mindestens eine Teilmenge der Transistorzellen als Transistorzellen (2 ) gemäß einem der Ansprüche 1 bis 8 ausgebildet ist, wobei die Schmelzsicherungseinrichtungen jeweils als Sollschmelzabschnitt (51 ) der Gateleiterstrukturen (81 ) ausgebildet sind. - Leistungstransistorbauelement nach Anspruch 9, dadurch gekennzeichnet, dass jede der Transistorzellen als eine Transistorzelle (
2 ) nach einem der Ansprüche 1 bis 8 ausgebildet ist. - Leistungstransistorbauelement mit – einem Gate-Anschluss (
44 ), – einer mit dem Gate-Anschluss (44 ) verbundenen Gateverdrahtungsleitung (81 ), – einer Mehrzahl von Zellenblöcken mit parallel geschalteten Transistorzellen (2 ) mit jeweils einer Gateleiterstruktur (5 ) mit einem Elektrodenabschnitt (52 ) und jeweils einem mit den Gateleiterstrukturen (5 ) der Transistorzellen des Zellenblocks verbundenen Gate-Zellenblockanschluss und – jeweils zwischen einem der Gate-Zellenblockanschlüsse und der Gateverdrahtungsleitung (81 ) vorgesehenen Schmelzsicherungseinrichtungen, dadurch gekennzeichnet, dass die Schmelzsicherungseinrichtungen jeweils in einem Hohlraum (6 ) vorgesehen sind.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE10358324A DE10358324A1 (de) | 2003-12-12 | 2003-12-12 | Leistungstransistorzelle und Leistungstransistorbauelement mit Schmelzsicherung |
US11/009,537 US7253475B2 (en) | 2003-12-12 | 2004-12-10 | Power transistor cell and power transistor component with fusible link |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE10358324A DE10358324A1 (de) | 2003-12-12 | 2003-12-12 | Leistungstransistorzelle und Leistungstransistorbauelement mit Schmelzsicherung |
Publications (1)
Publication Number | Publication Date |
---|---|
DE10358324A1 true DE10358324A1 (de) | 2005-07-14 |
Family
ID=34672687
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE10358324A Withdrawn DE10358324A1 (de) | 2003-12-12 | 2003-12-12 | Leistungstransistorzelle und Leistungstransistorbauelement mit Schmelzsicherung |
Country Status (2)
Country | Link |
---|---|
US (1) | US7253475B2 (de) |
DE (1) | DE10358324A1 (de) |
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